MediaTek MT8195 ADSP CPU clock binding 한국어 번역

Part 1

요약·해설

공식 원문 86줄과 property 4행을 전수 대조해 Description과 type·required·constant·default·legal value를 보존했습니다.

Compatible

mediatek,mt8195_cpuclk

Vendor

MediaTek Inc.

Properties

4 rows

Schema

MT8195 ADSP CPU frequency control

Part 2

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원문 SHA-256 37F655DA83F277C94304BAE85E1F8A93E4BFD2A6D89DA617EB4D4023A1EE3065

:orphan:

.. raw:: html

    <!--
    FIXME: do not limit page width until content uses another representation
    format other than tables
    -->
    <style>.wy-nav-content { max-width: none; !important }</style>

.. dtcompatible:: mediatek,mt8195_cpuclk
.. _dtbinding_mediatek_mt8195_cpuclk:

mediatek,mt8195_cpuclk
######################

Vendor: :ref:`MediaTek Inc. <dt_vendor_mediatek>`

Description
***********



.. code-block:: none

   MediaTek Audio DSP CPU Frequency Control

Properties
**********

.. tabs::

   .. group-tab:: Node specific properties

      Properties not inherited from the base binding file.

      .. list-table::
         :widths: 1 1 4
         :header-rows: 1

         * - Name
           - Type
           - Details

         * - ``freqs_mhz``
           - ``array``
           - .. code-block:: none

                Available frequencies in ascending order


             This property is **required**.

         * - ``cg_reg``
           - ``int``
           - 

         * - ``pll_ctrl_reg``
           - ``int``
           - 



   .. group-tab:: Deprecated node specific properties

      Deprecated properties not inherited from the base binding file.

      (None)

   .. group-tab:: Base properties

      Properties inherited from the base binding file, which defines
      common properties that may be set on many nodes. Not all of these
      may apply to the "mediatek,mt8195_cpuclk" compatible.

      .. list-table::
         :widths: 1 1 4
         :header-rows: 1

         * - Name
           - Type
           - Details

         * - ``reg``
           - ``array``
           - See :ref:`dt-important-props` for more information.

Part 3

한국어 전문 번역

`mediatek,mt8195_cpuclk`

Vendor: MediaTek Inc.

공식 설명

MediaTek Audio DSP CPU Frequency Control

MT8195 Audio DSP CPU의 사용 가능한 frequency와 clock/PLL register를 정의합니다.

ADSP frequency table

freqs_mhz는 지원 frequency를 MHz 단위 오름차순으로 나열한 필수 array입니다. cg_reg와 pll_ctrl_reg는 각각 clock-gating·PLL control register 값이며 optional입니다.

Parent/base에서 가져온 reg도 공식 표에 있지만 required로 표시되지 않습니다. 이 페이지에는 compatible이나 공통 device property 표가 없으므로 원문 범위를 그대로 유지했습니다.

Property

공식 Zephyr 3.7.0 schema의 모든 property를 옮겼습니다. Type과 required·deprecated·constant·default·legal value를 원문에서 직접 추출했습니다.

노드 전용 속성 · 3개

이름	형식	설명과 제약
`freqs_mhz`	`array`	지원 frequency를 MHz 단위 오름차순으로 나열한 배열입니다. 필수
`cg_reg`	`int`	MediaTek ADSP clock-gating register 값입니다.
`pll_ctrl_reg`	`int`	MediaTek ADSP PLL control register 값입니다.

Base binding property · 1개

공식 문서의 기본 속성을 빠짐없이 실었습니다.

이름	형식	설명과 제약
`reg`	`array`	장치 레지스터의 주소 범위를 지정합니다.

Source

출처

영어 원문에는 문단, 문서 지시문, 표, 코드, 코드 심벌, 경로를 그대로 보존했습니다.

MediaTek MT8195 ADSP CPU clock binding

2.7.0 LTS2 · 준비 중